Techniques de conception écoénergétiques sur FPGA – hinnat ja saatavuus
Objectif de conception à faible consommation d'énergie avec mise à l'échelle de la capacité, prise en compte thermique, normes HSTL, SSTL et LVCMOS IO et mise à l'échelle de la fréquence
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Dans cet ouvrage, nous avons con u un d codeur 64 bits, un d codeur compatible avec l'Internet des objets (IoT), un contr leur de feux de signalisation conome en nergie, des barri res automatiques bas es sur des capteurs pour les passages… Näytä koko kuvaus Piilota kuvaus
Dans cet ouvrage, nous avons con u un d codeur 64 bits, un d codeur compatible avec l'Internet des objets (IoT), un contr leur de feux de signalisation conome en nergie, des barri res automatiques bas es sur des capteurs pour les passages niveau publics, un capteur de charge mobile utilisant la norme LVCMOS IO, une montre-bracelet biom dicale, un lecteur Unicode pour le grec, le latin et le sindhi, une horloge num rique et un filtre FIR utilisant Verilog. Nous utilisons galement l'approche de conception bas e sur les objectifs, la mise l' chelle de la capacit , la mise l' chelle de la fr quence, la prise en compte thermique, le clock gating, la mise l' chelle de la tension, les normes d'E/S LVCMOS, HSTL et SSTL. Nous utilisons les derniers FPGA Virtex-6, Kintex-7 et Artix-7 bas s sur les technologies 28 nm et 40 nm. Nous utilisons XPower Analyzer pour l'estimation de la puissance et Xilinx pour la simulation du langage de description du mat riel. En r sum , nous avons couvert plus de 10 circuits diff rents et 10 techniques d'efficacit nerg tique diff rentes qui aideront les chercheurs et les apprenants acqu rir ces techniques et les appliquer dans leurs propres conceptions afin de r aliser des conceptions co nerg tiques avec Verilog.
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